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Nov 22 2025

gjnet - FPGA：邏輯功能的仿真與驗證_FPGA_timerring

一、新建tb文件 進行例化 定義輸入信號和輸出信號 將輸入信號與被測試模塊連接到一起 定義時鐘信號 含義是定義clk為高電平，延時10納秒後取反 定義復位信號 先通過復位將D觸發器設置為零，在仿真時間線上往後推移201ns，多等一納秒是為了避免

觸發器 , 時鐘週期 , 後端開發 , fpga開發 , 右鍵 , Python

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Dec 29 2025

mob64ca14048514 - Cypress USB 芯片固件修改

1. Win7 64下開發 　　需下載 CySuiteUSB_3_4_7_B204 http://www.cypress.com/?rID=34870 　　使用C:\Cypress\Cypress Suite USB 3.4.7\Driver\bin\wlh\x64下的驅動，並修改inf文件，如下： 　　 1 ;for x64 platforms

sed , 時鐘週期 , 固件 , 架構 , 後端開發 , Cypress USB 芯片固件修改

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